Electrónica digital: pack de repaso

Hojas de fórmulas, los pasos clave de los métodos de cada tema y 6 problemas de práctica, con las soluciones completas al final.

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1Fórmulas y métodos

Sistemas de numeración

Valores posicionales
binario 2k, octal 8k, hexadecimal 16k
A decimal
Σ dk·bk
Desde decimal
divide entre la base y lee los restos de abajo arriba
Hexadecimal ↔ binario
un dígito hexadecimal = 4 bits
Complemento a dos
invierte los bits y suma 1

Lógica digital: puertas, mapas K y biestables

Puertas básicas
A·B, A + B, A′, (A·B)′, (A + B)′, A ⊕ B
Reglas de Boole
X + X′ = 1, X·X′ = 0, X + XY = X, XY + XY′ = X
De Morgan
(X·Y)′ = X′ + Y′, (X + Y)′ = X′·Y′
Orden del mapa de Karnaugh
00, 01, 11, 10 (Gray code)
Grupo de 2ᵏ celdas
pierde k variables
Multiplexor de 4 a 1
F = A′B′I0 + A′BI1 + AB′I2 + ABI3
Biestables
D: Q⁺ = D, T: Q⁺ = T ⊕ Q, JK: Q⁺ = JQ′ + K′Q
Contadores
n bits: 2ⁿ estados; módulo N: el menor n con 2ⁿ ≥ N; fsal = fclk/N
Contador asíncrono
fmax = 1/(n·tpd)
Contadores en anillo y Johnson
n y 2n estados

Método

  1. En un circuito, trabaja desde las entradas hasta la salida puerta por puerta y escribe el valor en cada hilo, o escribe su expresión y rellena la tabla de verdad.
  2. Para simplificar, coloca los 1 (y las indiferencias como X) en un mapa de Karnaugh con filas y columnas en código Gray: 00, 01, 11, 10.
  3. Cubre los 1 con los menos grupos posibles y lo más grandes posible, de 1, 2, 4, 8 o 16 celdas, envolviendo los bordes; cada grupo es un término producto formado por las variables que permanecen constantes. Agrupa los 0 para la forma POS.
  4. En biestables y contadores, lee las entradas en cada flanco activo del reloj, anota el estado tras cada flanco y recuerda que un contador de n bits da la vuelta tras 2ⁿ estados.

Adquisición de datos y muestreo

Criterio de Nyquist
fs > 2·fmax, fN = fs/2
Frecuencia de aliasing
fa = |f − k·fs|, k = round(f/fs)
Tamaño del paso
1 LSB = VFSR/2ᴺ
Error de cuantización (redondeo)
±½ LSB
Código del ADC con truncamiento
D = ⌊Vin/LSB⌋
Bits para una resolución r
2ᴺ ≥ span/r
SQNR ideal, senoide a fondo de escala
SQNR = 6,02·N + 1,76 dB
Tasa de datos
canales × fs × N bit/s
ADC multiplexado
fs = 1/(n·(tc + tset))
UART
Tb = 1/baudios; 8N1 = 10 bits por byte; bytes/s = baudios/bits por trama
Divisor de la tasa de baudios
baud = fclk/(16·D)

Método

  1. Anota los datos: frecuencia de muestreo, frecuencias de la señal, número de bits, rango de entrada, tasa de baudios.
  2. En las preguntas de muestreo, compara cada frecuencia con fs/2; una frecuencia mayor aparece en fa = |f − k·fs|, con el múltiplo de fs más cercano.
  3. En las preguntas de resolución, halla 1 LSB = VFSR/2ᴺ, o el menor N con 2ᴺ ≥ rango/resolución.
  4. En las tasas de datos y los enlaces UART, cuenta todo lo que se envía: canales, muestras por segundo, bits o bytes completos por muestra, y los bits de inicio, paridad y parada de cada trama.

2Problemas de práctica

1.Sistemas de numeraciónMedia
valores posicionales en complemento a dos1−12816403201608141211

El patrón de 8 bits 1100 0111 guarda un entero con signo en complemento a dos. ¿Cuál es su valor N en decimal?

1100 01118 bit
N =
2.Sistemas de numeraciónDifícil
32 bit1 px640 px480 pxM = ? KiB

Una imagen sin comprimir tiene 640 × 480 píxeles con 32 bits por píxel. ¿Cuánta memoria M ocupa, en KiB (1 KiB = 1024 bytes)?

640 × 480 px32 bit/px1 KiB = 1024 B
M = KiB
3.Lógica digital: puertas, mapas K y biestablesMedia
ABC000111100101324576

Simplifica F = BC′ + A′BC′ + ABC′ + A′C′ a su forma mínima de suma de productos. ¿Cuántos literales, L, contiene la expresión simplificada?

F = BC′ + A′BC′ + ABC′ + A′C′
L =
4.Lógica digital: puertas, mapas K y biestablesDifícil
CLKT123456

Un biestable T activado por flanco de subida empieza con Q = 0 y recibe las entradas mostradas en 6 flancos de subida del reloj. ¿Cuántas veces, N, cambia Q de estado?

Q₀ = 0T
N =
5.Adquisición de datos y muestreoMedia
Vin​N = 810 V2ᴺ − 101 LSB6,861 V?

Un ADC de 8 bits con un rango de entrada de 0 a 10 V trunca: su código de salida es ⌊Vin/LSB⌋ con 1 LSB = VFSR/2ᴺ. Halla el código de salida decimal D para una entrada de 6,861 V.

N = 8VFSR = 10 VVin = 6,861 V
D =
6.Adquisición de datos y muestreoDifícil
SD0​D1​D2​D3​D4​D5​D6​D7​Tb​10·Tb​115200 Bd, 8N1

Un ADC de 10 bits envía cada muestra por una UART a 115200 baudios, formato 8N1 (bit de inicio, 8 bits de datos, 1 bit de parada). Cada muestra se envía como 2 byte(s) completo(s) y el enlace está ocupado todo el tiempo. Halla la frecuencia de señal más alta fmax que se puede muestrear sin aliasing, en Hz.

baud = 115200 BdN = 108N1
fmax = Hz

3Disoluciones

1.Sistemas de numeración

Respuesta: N = −57

Sistemas de numeración posicionales: cada dígito vale su valor por una potencia de la base. En binario las posiciones valen 1, 2, 4, 8, 16, …; en hexadecimal 1, 16, 256, …, con A–F para 10–15. En complemento a dos de 8 bits, el bit de la izquierda vale −128 en vez de +128; así se guardan los números negativos.

Sumar los valores posicionales

Los demás bits conservan sus valores positivos normales.

−128 + 64 + 4 + 2 + 1 = −57

Respuesta

N = −57
2.Sistemas de numeración

Respuesta: M = 1200 KiB

Sistemas de numeración posicionales: cada dígito vale su valor por una potencia de la base. En binario las posiciones valen 1, 2, 4, 8, 16, …; en hexadecimal 1, 16, 256, …, con A–F para 10–15. En complemento a dos de 8 bits, el bit de la izquierda vale −128 en vez de +128; así se guardan los números negativos.

Bits y bytes

640·480·32 = 9830400 bit = 1228800 B

Pasar a KiB

1228800/1024 = 1200 KiB

Respuesta

M = 1200 KiB
3.Lógica digital: puertas, mapas K y biestables

Respuesta: L = 4

Álgebra de Boole: las reglas que simplifican expresiones son X + X′ = 1 y X·X′ = 0, X + X = X, la absorción X + X·Y = X, la regla de combinación X·Y + X·Y′ = X, X + X′Y = X + Y y el teorema del consenso XY + X′Z + YZ = XY + X′Z. Las leyes de De Morgan convierten (X·Y)′ en X′ + Y′ y (X + Y)′ en X′·Y′. Un mapa de Karnaugh aplica estas reglas de forma gráfica: cada grupo de dos celdas vecinas es un uso de XY + XY′ = X.

Minitérminos de la expresión

BC′ → m(2, 6)
A′BC′ → m(2)
ABC′ → m(6)
A′C′ → m(0, 2)
ABC00011110011001031204050716

Agrupa y lee

F = BC′ + A′C′

Cuenta los literales

L = 4

Respuesta

L = 4
4.Lógica digital: puertas, mapas K y biestables

Respuesta: N = 6

Biestables y contadores: un biestable cambia solo en el flanco activo del reloj. D copia su entrada (Q⁺ = D); T conmuta cuando T = 1; JK mantiene con 00, pone a 0 con 01, pone a 1 con 10 y conmuta con 11. Un contador binario de n bits tiene 2ⁿ estados y cuenta módulo 2ⁿ; un contador módulo N cuenta 0, 1, …, N − 1 y vuelve a 0, y necesita el menor n con 2ⁿ ≥ N biestables. Cada etapa de un contador asíncrono divide la frecuencia a la mitad, así que la última salida de un contador módulo N funciona a fclk/N. Un contador Johnson de n biestables tiene 2n estados y un contador en anillo, n.

Q tras cada flanco

Un biestable T conmuta en cada flanco de subida con T = 1 y se mantiene con T = 0.

1: T = 1 → Q = 1
2: T = 1 → Q = 0
3: T = 1 → Q = 1
4: T = 1 → Q = 0
5: T = 1 → Q = 1
6: T = 1 → Q = 0

Cuenta los cambios

0 → 1 → 0 → 1 → 0 → 1 → 0
N = 6

Respuesta

N = 6
5.Adquisición de datos y muestreo

Respuesta: D = 175

Resolución del ADC: un convertidor de N bits divide su rango de fondo de escala VFSR en 2ᴺ códigos, de 0 a 2ᴺ − 1. Un paso es 1 LSB = VFSR/2ᴺ: el cambio más pequeño que puede mostrar el convertidor. Un ADC con truncamiento da el código ⌊Vin/LSB⌋; un ADC con redondeo nunca se aparta más de ½ LSB del valor real, que es su error de cuantización. Cada bit adicional reduce a la mitad el LSB y suma unos 6 dB a la relación señal/ruido de cuantización ideal SQNR = 6,02·N + 1,76 dB para una senoide a fondo de escala. Para alcanzar una resolución r en un rango, elige el menor N con 2ᴺ ≥ rango/r.

Tamaño del paso

1 LSB = 10/28 = 39,06 mV

Código

Vin/LSB = 6861/39,06 = 175,6
código = ⌊175,6⌋ = 175

Respuesta

D = 175

En binario es 10101111.

6.Adquisición de datos y muestreo

Respuesta: fmax = 2880 Hz

UART: un enlace serie asíncrono envía cada byte como una trama: un bit de inicio (nivel bajo), los bits de datos, un bit de paridad opcional y uno o dos bits de parada (nivel alto). La tasa de baudios es el número de bits por segundo, así que un bit dura Tb = 1/baudios y una trama de n bits dura n/baudios. El formato habitual 8N1 tiene 10 bits por byte. El generador de baudios divide el reloj: baudios = fclk/(16·D) con un número entero D, así que la tasa de baudios real difiere ligeramente de la deseada; un error inferior a aproximadamente el 2 % suele ser aceptable.

Bits por muestra en la línea

2·10 = 20 bit

Frecuencia de muestreo más alta

fs,max = 115200/20 = 5760 Hz

Límite de Nyquist

fmax = 5760/2 = 2880 Hz

Respuesta

fmax = 2880 Hz

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