디지털 전자공학: 벼락치기 팩

공식 모음, 모든 주제의 핵심 풀이 단계, 연습 문제 6개가 들어 있으며 전체 풀이는 맨 뒤에 있습니다.

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1공식과 풀이 방법

진법

자릿값: 2진수 2^k, 8진수 8^k, 16진수 16^k
10진수로: Σ d_k·b^k
10진수에서: 기수로 나누고, 나머지를 아래에서 위로 읽음
16진수 ↔ 2진수: 16진수 한 자리 = 4비트
2의 보수: 비트를 반전하고 1을 더함

디지털 논리: 게이트, 카르노 맵, 플립플롭

기본 게이트: A·B, A + B, A′, (A·B)′, (A + B)′, A ⊕ B
불 규칙: X + X′ = 1, X·X′ = 0, X + XY = X, XY + XY′ = X
드모르간 법칙: (X·Y)′ = X′ + Y′, (X + Y)′ = X′·Y′
카르노 맵의 순서: 00, 01, 11, 10 (Gray code)
2ᵏ칸의 그룹: 변수 k개를 잃음
4-대-1 멀티플렉서: F = A′B′I₀ + A′BI₁ + AB′I₂ + ABI₃
플립플롭: D: Q⁺ = D, T: Q⁺ = T ⊕ Q, JK: Q⁺ = JQ′ + K′Q
카운터: n비트: 2ⁿ개 상태; mod-N: 2ⁿ ≥ N인 가장 작은 n; f_out = f_clk/N
리플 카운터: f_max = 1/(n·t_pd)
링 카운터와 존슨 카운터: 상태 n개와 2n개

방법

회로는 입력에서 출력까지 게이트를 하나씩 따라가며 모든 선에 값을 적거나, 식을 쓰고 진리표를 채우세요.
간소화할 때는 1(그리고 무정의항은 X)을 그레이 코드 행과 열(00, 01, 11, 10)을 가진 카르노 맵에 넣으세요.
1들을 1, 2, 4, 8, 16칸의 가능한 한 적고 큰 그룹으로 덮되 가장자리를 넘어 이어 보세요. 각 그룹은 일정하게 유지되는 변수로 이루어진 곱항 하나입니다. POS 형태는 0들을 묶으세요.
플립플롭과 카운터는 활성 클록 에지마다 입력을 읽고, 에지마다 상태를 적고, n비트 카운터는 2ⁿ개 상태 뒤에 되돌아간다는 것을 기억하세요.

데이터 수집과 표본화

나이퀴스트 조건: f_s > 2·f_max, f_N = f_s/2
에일리어스 주파수: f_a = |f − k·f_s|, k = round(f/f_s)
스텝 크기: 1 LSB = V_FSR/2ᴺ
양자화 오차(반올림): ±½ LSB
절사형 ADC 코드: D = ⌊V_in/LSB⌋
분해능 r에 필요한 비트 수: 2ᴺ ≥ span/r
이상적인 SQNR, 풀스케일 사인파: SQNR = 6.02·N + 1.76 dB
데이터 전송률: 채널 수 × f_s × N bit/s
멀티플렉스 ADC: f_s = 1/(n·(t_c + t_set))
UART: T_b = 1/baud; 8N1 = 바이트당 10비트; bytes/s = baud/프레임당 비트 수
보율 분주기: baud = f_clk/(16·D)

방법

주어진 값을 적으세요: 표본화율, 신호 주파수, 비트 수, 입력 범위, 보율.
표본화 문제에서는 각 주파수를 f_s/2와 비교하세요. 더 높은 주파수는 f_s의 가장 가까운 배수를 이용해 f_a = |f − k·f_s|에 나타납니다.
분해능 문제에서는 1 LSB = V_FSR/2ᴺ을 구하거나, 2ᴺ ≥ 범위/분해능을 만족하는 가장 작은 N을 찾으세요.
데이터 전송률과 UART 링크 문제에서는 전송되는 모든 것을 세세요: 채널, 초당 표본 수, 표본당 비트 또는 전체 바이트, 그리고 모든 프레임의 시작, 패리티, 정지 비트.

2연습 문제

1.진법보통

8비트 2의 보수로 −114을 저장하도록 비트를 설정하세요. 부호 없는 수로 읽으면 패턴의 값 U은 얼마입니까?

N = −1148 bit

U =

2.진법어려움

1100 0011 >> 3의 8비트 결과가 되도록 비트를 설정하세요. 결과의 값 R은 십진수로 얼마입니까?

1100 0011>> 3

R =

3.디지털 논리: 게이트, 카르노 맵, 플립플롭보통

4-대-1 멀티플렉서의 선택 입력은 S₁ = A, S₀ = B이고 데이터 입력은 I₀ = C, I₁ = C, I₂ = 0, I₃ = C에 연결되어 있다. A, B, C의 8가지 조합 중 몇 개에서 출력 F = 1인가? N을(를) 구하시오.

I₀ = CI₁ = CI₂ = 0I₃ = C

N =

4.디지털 논리: 게이트, 카르노 맵, 플립플롭어려움

상승 에지 트리거 JK 플립플롭이 Q = 0에서 시작하여 그림의 입력을 상승 클록 에지 8번에 걸쳐 받는다. Q의 상태는 몇 번(N) 바뀌는가?

Q₀ = 0JK

N =

5.데이터 수집과 표본화보통

입력 범위 0~3.3 V인 12비트 ADC가 절사합니다: 출력 코드는 1 LSB = V_FSR/2ᴺ일 때 ⌊V_in/LSB⌋입니다. 입력이 1.465 V일 때 십진수 출력 코드 D을(를) 구하시오.

N = 12V_FSR = 3.3 VV_in = 1.465 V

D =

6.데이터 수집과 표본화어려움

12비트 ADC가 모든 표본을 460800 baud, 8N1 형식(시작 비트, 데이터 비트 8개, 정지 비트 1개)의 UART로 계속 전송합니다. 각 표본은 2바이트로 전송되고 링크는 항상 사용 중입니다. 에일리어싱 없이 표본화할 수 있는 최고 신호 주파수 f_max을(를) Hz 단위로 구하시오.

baud = 460800 BdN = 128N1

f_max = Hz

3용액

1.진법

답: U = 142

비트 설정: 각 비트는 2의 거듭제곱(128, 64, …, 1)의 값을 가집니다. 16진수 한 자리는 정확히 네 비트이고, 8비트 2의 보수에서 맨 왼쪽 비트의 값은 −128입니다. 비트 연산은 각 비트 자리를 따로 처리합니다.

반전하고 1 더하기

114 = 0111 0010

반전 후: 1000 1101

+1 → 1000 1110

부호 없는 수로 읽기

1000 1110₂ = 256 − 114 = 142

답

U = 142

2.진법

답: R = 24

비트별로

3만큼 오른쪽으로 시프트하면 모든 비트가 3칸 오른쪽으로 이동합니다. 오른쪽 끝에서 밀려난 비트는 사라지고 왼쪽에 0이 들어옵니다.

1100 0011 >> 3

= 0001 1000

결과의 값

0001 1000₂ = 24

답

R = 24

3.디지털 논리: 게이트, 카르노 맵, 플립플롭

답: N = 3

멀티플렉서: 2ⁿ-대-1 멀티플렉서는 데이터 입력 중 하나를 출력으로 보내며, 선택선을 이진수로 읽어 어느 것인지 정합니다. 선택선 S₁S₀ = AB인 4-대-1 MUX에서는 F = A′B′·I₀ + A′B·I₁ + AB′·I₂ + AB·I₃입니다. 데이터 입력을 0, 1, C, C′에 연결하면 MUX가 A, B, C의 어떤 함수든 만들 수 있으며, 이는 칩 하나로 논리를 구현하는 흔한 방법입니다.

출력식

F = A′B′C + A′BC + ABC

F = 1인 행

ABC = 001, 011, 111

N = 3

답

N = 3

4.디지털 논리: 게이트, 카르노 맵, 플립플롭

답: N = 3

플립플롭과 카운터: 플립플롭은 클록의 활성 에지에서만 바뀝니다. D는 입력을 복사합니다(Q⁺ = D). T는 T = 1이면 토글합니다. JK는 00이면 유지, 01이면 리셋, 10이면 셋, 11이면 토글합니다. n비트 이진 카운터는 상태가 2ⁿ개이고 2ⁿ을 법으로 세며, mod-N 카운터는 0, 1, …, N − 1을 거쳐 다시 0으로 돌아가고 2ⁿ ≥ N인 가장 작은 n개의 플립플롭이 필요합니다. 리플 카운터는 단마다 주파수가 절반이 되므로 mod-N 카운터의 마지막 출력은 f_clk/N으로 동작합니다. 플립플롭 n개의 존슨 카운터는 상태가 2n개, 링 카운터는 n개입니다.

에지마다의 Q

JK 플립플롭: 00은 유지, 01은 리셋(Q = 0), 10은 셋(Q = 1), 11은 토글.

1: J = 0, K = 0 → Q = 0

2: J = 0, K = 1 → Q = 0

3: J = 1, K = 0 → Q = 1

4: J = 1, K = 0 → Q = 1

5: J = 0, K = 0 → Q = 1

6: J = 1, K = 1 → Q = 0

7: J = 1, K = 1 → Q = 1

8: J = 1, K = 0 → Q = 1

변화 세기

0 → 0 → 0 → 1 → 1 → 1 → 0 → 1 → 1

N = 3

답

N = 3

5.데이터 수집과 표본화

답: D = 1818

ADC 분해능: N비트 변환기는 풀스케일 범위 V_FSR을 0부터 2ᴺ − 1까지 2ᴺ개의 코드로 나눕니다. 한 스텝은 1 LSB = V_FSR/2ᴺ로, 변환기가 나타낼 수 있는 가장 작은 변화입니다. 절사형 ADC는 코드 ⌊V_in/LSB⌋를 주고, 반올림형 ADC는 참값에서 ½ LSB 넘게 벗어나지 않으며 이것이 양자화 오차입니다. 비트가 하나 늘 때마다 LSB는 절반이 되고, 풀스케일 사인파에 대한 이상적인 신호 대 양자화 잡음비 SQNR = 6.02·N + 1.76 dB는 약 6 dB 높아집니다. 범위에서 분해능 r을 얻으려면 2ᴺ ≥ 범위/r을 만족하는 가장 작은 N을 고르세요.

스텝 크기

1 LSB = 3.3/2¹² = 0.8057 mV

코드

V_in/LSB = 1465/0.8057 = 1818

코드 = ⌊1818⌋ = 1818

답

D = 1818

이진수로는 011100011010입니다.

6.데이터 수집과 표본화

답: f_max = 11520 Hz

UART: 비동기 직렬 링크는 각 바이트를 프레임으로 보냅니다. 시작 비트 1개(low), 데이터 비트, 선택적 패리티 비트, 정지 비트 1~2개(high)입니다. 보율은 초당 비트 수이므로 한 비트는 T_b = 1/baud 동안 지속되고, n비트 프레임은 n/baud 동안 지속됩니다. 흔히 쓰는 8N1 형식은 바이트당 10비트입니다. 보율 발생기는 클록을 나눕니다: baud = f_clk/(16·D)이며 D는 정수이므로 실제 보율은 목표값과 조금 다릅니다. 오차가 약 2 % 미만이면 보통 허용됩니다.

선로상의 표본당 비트 수

2·10 = 20 bit

최고 표본화율

f_s,max = 460800/20 = 23040 Hz

나이퀴스트 한계

f_max = 23040/2 = 11520 Hz

답

f_max = 11520 Hz

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