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Formulari, i passaggi chiave del metodo per ogni argomento e 6 esercizi, con le soluzioni complete in fondo.

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1Formule e metodi

Sistemi di numerazione

Pesi delle posizioni
binario 2k, ottale 8k, esadecimale 16k
In decimale
Σ dk·bk
Da decimale
dividi per la base e leggi i resti dal basso verso l’alto
Esadecimale ↔ binario
una cifra esadecimale = 4 bit
Complemento a due
inverti i bit e aggiungi 1

Logica digitale: porte, mappe K e flip-flop

Porte di base
A·B, A + B, A′, (A·B)′, (A + B)′, A ⊕ B
Regole booleane
X + X′ = 1, X·X′ = 0, X + XY = X, XY + XY′ = X
De Morgan
(X·Y)′ = X′ + Y′, (X + Y)′ = X′·Y′
Ordine della mappa di Karnaugh
00, 01, 11, 10 (Gray code)
Gruppo di 2ᵏ celle
perde k variabili
Multiplexer 4 a 1
F = A′B′I0 + A′BI1 + AB′I2 + ABI3
Flip-flop
D: Q⁺ = D, T: Q⁺ = T ⊕ Q, JK: Q⁺ = JQ′ + K′Q
Contatori
n bit: 2ⁿ stati; mod N: n minimo con 2ⁿ ≥ N; fout = fclk/N
Contatore asincrono (ripple)
fmax = 1/(n·tpd)
Contatori ad anello e Johnson
n e 2n stati

Metodo

  1. Per un circuito, procedi dagli ingressi all’uscita una porta alla volta e scrivi il valore su ogni filo, oppure scrivi la sua espressione e compila la tabella di verità.
  2. Per la semplificazione, riporta gli 1 (e le condizioni di indifferenza come X) in una mappa di Karnaugh con righe e colonne in codice Gray: 00, 01, 11, 10.
  3. Copri gli 1 con il minor numero possibile di gruppi, i più grandi possibile, di 1, 2, 4, 8 o 16 celle, richiudendoli sui bordi; ogni gruppo è un termine prodotto formato dalle variabili che restano costanti. Raggruppa gli 0 per la forma POS.
  4. Per flip-flop e contatori, leggi gli ingressi a ogni fronte attivo del clock, scrivi lo stato dopo ogni fronte e ricorda che un contatore a n bit ricomincia da capo dopo 2ⁿ stati.

Acquisizione dati e campionamento

Criterio di Nyquist
fs > 2·fmax, fN = fs/2
Frequenza di alias
fa = |f − k·fs|, k = round(f/fs)
Passo di quantizzazione
1 LSB = VFSR/2ᴺ
Errore di quantizzazione (arrotondamento)
±½ LSB
Codice di un ADC a troncamento
D = ⌊Vin/LSB⌋
Bit per una risoluzione r
2ᴺ ≥ span/r
SQNR ideale, sinusoide a fondo scala
SQNR = 6,02·N + 1,76 dB
Velocità dei dati
canali × fs × N bit/s
ADC multiplexato
fs = 1/(n·(tc + tset))
UART
Tb = 1/baud; 8N1 = 10 bit per byte; byte/s = baud/bit per frame
Divisore del baud rate
baud = fclk/(16·D)

Metodo

  1. Scrivi i dati: frequenza di campionamento, frequenze del segnale, numero di bit, campo d’ingresso, baud rate.
  2. Nei problemi di campionamento confronta ogni frequenza con fs/2; una frequenza più alta compare a fa = |f − k·fs|, con il multiplo di fs più vicino.
  3. Nei problemi di risoluzione trova 1 LSB = VFSR/2ᴺ, oppure il più piccolo N con 2ᴺ ≥ campo/risoluzione.
  4. Per velocità dei dati e collegamenti UART conta tutto ciò che viene inviato: canali, campioni al secondo, bit o byte interi per campione, e i bit di start, parità e stop di ogni frame.

2Esercizi

1.Sistemi di numerazioneMedia
complemento a due a 8 bit0−12806403201608040201

Imposta i bit in modo che memorizzino −16 in complemento a due a 8 bit. Letto come numero senza segno, qual è il valore U dello schema?

N = −168 bit
U =
2.Sistemi di numerazioneDifficile
clicca i bit per impostarli012806403201608040201

Imposta i bit sul risultato a 8 bit di 1000 1011 << 3. Qual è il valore R del risultato in decimale?

1000 1011<< 3
R =
3.Logica digitale: porte, mappe K e flip-flopMedia
ABC000111100101324576

Semplifica F = AB′ + AB′C′ + A′B′C′ alla sua forma minima a somma di prodotti. Quanti letterali L contiene l’espressione semplificata?

F = AB′ + AB′C′ + A′B′C′
L =
4.Logica digitale: porte, mappe K e flip-flopDifficile
ABCD000111100001111010X11302041507061121131150141819111X10

Trova la forma SOP minima di F(A, B, C, D) = Σm(0, 3, 5, 8, 9, 11, 12, 13, 15) + d(1, 10), dove d indica le condizioni di indifferenza. Quanti termini prodotto N ha?

F(A, B, C, D) = Σm(0, 3, 5, 8, 9, 11, 12, 13, 15) + d(1, 10)
N =
5.Acquisizione dati e campionamentoMedia
Vin​N = 20VFSR​2ᴺ − 101 LSB

Trova il rapporto segnale/rumore di quantizzazione ideale SQNR di un ADC a 20 bit per una sinusoide a fondo scala.

N = 20
SQNR = dB
6.Acquisizione dati e campionamentoDifficile
SD0​D1​D2​D3​D4​D5​D6​D7​1/fbaud​32 MHz / (16·D)

Un microcontrollore con clock a 32 MHz imposta il baud rate della UART come fclk/(16·D), con D un numero intero arrotondato al valore più vicino. Il valore desiderato è 9600 baud. Trova l’errore percentuale del baud rate reale (positivo se è troppo veloce).

fclk = 32 MHzvalore desiderato = 9600 Bd
e = %

3Soluzioni

1.Sistemi di numerazione

Risposta: U = 240

Impostare i bit: ogni bit vale una potenza di due (128, 64, …, 1). Una cifra esadecimale è esattamente quattro bit, e nel complemento a due a 8 bit il bit più a sinistra vale −128. Le operazioni bit a bit lavorano su ogni posizione di bit separatamente.

Inverti e aggiungi uno

16 = 0001 0000
invertito: 1110 1111
+1 → 1111 0000

Leggilo senza segno

1111 0000₂ = 256 − 16 = 240

Risposta

U = 240
2.Sistemi di numerazione

Risposta: R = 88

Impostare i bit: ogni bit vale una potenza di due (128, 64, …, 1). Una cifra esadecimale è esattamente quattro bit, e nel complemento a due a 8 bit il bit più a sinistra vale −128. Le operazioni bit a bit lavorano su ogni posizione di bit separatamente.

Bit per bit

Scorrere a sinistra di 3 sposta ogni bit di 3 posizioni verso sinistra; i bit che escono dall’estremità sinistra sono persi ed entrano zeri a destra.

1000 1011 << 3
= 0101 1000

Valore del risultato

0101 1000₂ = 88

Risposta

R = 88
3.Logica digitale: porte, mappe K e flip-flop

Risposta: L = 4

Algebra di Boole: le regole che semplificano le espressioni sono X + X′ = 1 e X·X′ = 0, X + X = X, l’assorbimento X + X·Y = X, la regola di combinazione X·Y + X·Y′ = X, X + X′Y = X + Y e il teorema del consenso XY + X′Z + YZ = XY + X′Z. Le leggi di De Morgan trasformano (X·Y)′ in X′ + Y′ e (X + Y)′ in X′·Y′. Una mappa di Karnaugh applica queste regole in forma grafica: ogni gruppo di due celle vicine è un uso di XY + XY′ = X.

Mintermini dell’espressione

AB′ → m(4, 5)
AB′C′ → m(4)
A′B′C′ → m(0)
ABC00011110011001030214150706

Raggruppa e leggi

F = B′C′ + AB′

Conta i letterali

L = 4

Risposta

L = 4
4.Logica digitale: porte, mappe K e flip-flop

Risposta: N = 5

Mappe di Karnaugh: le celle sono ordinate in codice Gray (00, 01, 11, 10), quindi le celle vicine, comprese quelle attraverso i bordi, differiscono per esattamente una variabile. Raggruppa gli 1 in rettangoli di 1, 2, 4, 8 o 16 celle, i più grandi e il meno numerosi possibile, finché ogni 1 non è coperto. Ogni gruppo è un termine prodotto: le variabili che restano costanti al suo interno. Un gruppo di 2ᵏ celle perde k variabili. Le condizioni di indifferenza (X) possono servire a ingrandire i gruppi ma non devono mai essere coperte. Raggruppando invece gli 0 si ottiene la forma POS minima.

Implicanti primi

I gruppi più grandi che si possono formare con 1 e X.

C′D, B′D, B′C′, AD, AC′, AB′
ABCD000111100001111010X11302041507061121131150141819111X10

Copertura minima

F = C′D + B′D + B′C′ + AD + AC′
N = 5

Risposta

N = 5
5.Acquisizione dati e campionamento

Risposta: SQNR = 122,2 dB

Risoluzione dell’ADC: un convertitore a N bit divide il suo campo di fondo scala VFSR in 2ᴺ codici, da 0 a 2ᴺ − 1. Un passo è 1 LSB = VFSR/2ᴺ: la più piccola variazione che il convertitore può mostrare. Un ADC a troncamento dà il codice ⌊Vin/LSB⌋; un ADC ad arrotondamento non si discosta mai più di ½ LSB dal valore vero, il suo errore di quantizzazione. Ogni bit in più dimezza l’LSB e aggiunge circa 6 dB al rapporto segnale/rumore di quantizzazione ideale SQNR = 6,02·N + 1,76 dB per una sinusoide a fondo scala. Per ottenere una risoluzione r su un campo, scegli il più piccolo N con 2ᴺ ≥ campo/r.

SQNR ideale

SQNR = 6,02·20 + 1,76 = 122,2 dB

Risposta

SQNR = 122,2 dB
6.Acquisizione dati e campionamento

Risposta: e = 0,1603 %

UART: un collegamento seriale asincrono invia ogni byte come un frame: un bit di start (basso), i bit di dati, un bit di parità facoltativo e uno o due bit di stop (alti). Il baud rate è il numero di bit al secondo, quindi un bit dura Tb = 1/baud e un frame di n bit dura n/baud. Il comune formato 8N1 ha 10 bit per byte. Il generatore di baud divide il clock: baud = fclk/(16·D) con un numero intero D, quindi il baud rate reale differisce leggermente da quello desiderato; un errore sotto circa il 2 % di solito è accettabile.

Divisore

D = 32·10⁶/(16·9600) = 208,3 → 208

Baud rate reale

32·10⁶/(16·208) = 9615 Bd

Errore

(9615 − 9600)/9600·100 = 0,1603 %

Risposta

e = 0,1603 %

Un errore sotto circa il 2 % di solito è accettabile.

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