Scheda di esercizi di Logica digitale: porte, mappe K e flip-flop con soluzioni

Scheda di esercizi di Logica digitale: porte, mappe K e flip-flop gratuita e stampabile: 6 esercizi dal livello facile a quello d’esame, con le soluzioni. Stampala o salvala come PDF.

Per i docenti: gratuita da stampare, copiare e usare in classe. Ogni nuova scheda ha nuovi valori e le sue soluzioni. Un link a ExamProblems nella pagina del corso è molto apprezzato.

Nome: ____________________   Data: ____________

1.Facile
A = 0B = 1C = 1N1G1G2F

Gli ingressi del circuito logico sono A = 0, B = 1 e C = 1. Esattamente una delle sue porte ha uscita 0. Clicca su quella porta.

A = 0B = 1C = 1
  1. 1N1
  2. 2G1
  3. 3G2
2.Facile
ABCG1N1G2G3F

Per il circuito logico mostrato, quante delle 8 combinazioni degli ingressi A, B e C danno uscita F = 1? Trova N.

A, B, C → F
N =
3.Media
ABC00011110010001131214151706

Usa la mappa di Karnaugh per trovare la forma minima a somma di prodotti (SOP) di F(A, B, C) = Σm(2, 3, 4, 5, 7). Quanti termini prodotto N ha?

F(A, B, C) = Σm(2, 3, 4, 5, 7)
N =
4.Media
ABCD000111100001111010011312140507060120130150141819011010

Usa la mappa di Karnaugh per trovare la forma minima a somma di prodotti (SOP) di F(A, B, C, D) = Σm(0, 2, 3, 4, 8, 9). Quanti letterali L contiene in totale (una variabile con apice conta come un letterale)?

F(A, B, C, D) = Σm(0, 2, 3, 4, 8, 9)
L =
5.Difficile
TQ0​Q0​TQ1​Q1​TQ2​Q2​CLK

Un contatore asincrono (ripple) a 3 bit è costruito con flip-flop ciascuno con un ritardo di propagazione di 10 ns. Tutte le uscite devono essersi stabilizzate prima del fronte di clock successivo. Trova la frequenza di clock massima fmax.

n = 3tpd = 10 ns
fmax = MHz
6.Difficile
CLKJK1234567

Un flip-flop JK sensibile al fronte di salita parte con Q = 0 e riceve gli ingressi mostrati in 7 fronti di salita del clock. Quante volte N Q cambia stato?

Q₀ = 0JK
N =

Soluzioni

  1. 1. G2
  2. 2. N = 6
  3. 3. N = 3
  4. 4. L = 9
  5. 5. fmax = 33,33 MHz
  6. 6. N = 3

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