डिजिटल इलेक्ट्रॉनिकी: क्रैम पैक

सूत्र-पत्रक, हर विषय के मुख्य विधि-चरण और 6 अभ्यास प्रश्न, पूरे हल पीछे दिए गए हैं।

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1सूत्र और विधियाँ

संख्या पद्धतियाँ

स्थानीय मान: बाइनरी 2^k, ऑक्टल 8^k, हेक्स 16^k
दशमलव में: Σ d_k·b^k
दशमलव से: आधार से भाग दें, शेषफल नीचे से ऊपर पढ़ें
हेक्स ↔ बाइनरी: एक हेक्स अंक = 4 बिट
टू’ज़ कॉम्प्लीमेंट: बिट उलटें और 1 जोड़ें

डिजिटल लॉजिक: गेट, K-मानचित्र और फ़्लिप-फ़्लॉप

मूल गेट: A·B, A + B, A′, (A·B)′, (A + B)′, A ⊕ B
बूलीय नियम: X + X′ = 1, X·X′ = 0, X + XY = X, XY + XY′ = X
डी मॉर्गन: (X·Y)′ = X′ + Y′, (X + Y)′ = X′·Y′
कार्नो मानचित्र का क्रम: 00, 01, 11, 10 (Gray code)
2ᵏ खानों का समूह: k चर खो देता है
4-से-1 मल्टीप्लेक्सर: F = A′B′I₀ + A′BI₁ + AB′I₂ + ABI₃
फ़्लिप-फ़्लॉप: D: Q⁺ = D, T: Q⁺ = T ⊕ Q, JK: Q⁺ = JQ′ + K′Q
काउंटर: n-बिट: 2ⁿ अवस्थाएँ; mod-N: सबसे छोटा n जिसमें 2ⁿ ≥ N; f_out = f_clk/N
रिपल काउंटर: f_max = 1/(n·t_pd)
रिंग और जॉनसन काउंटर: n और 2n अवस्थाएँ

विधि

परिपथ के लिए निवेशों से निर्गत तक एक-एक गेट करके काम करें और हर तार पर मान लिखें, या उसका व्यंजक लिखें और सत्यमान सारणी भरें।
सरलीकरण के लिए 1 (और डोंट-केयर को X के रूप में) को ग्रे-कोड पंक्तियों और स्तंभों वाले कार्नो मानचित्र में रखें: 00, 01, 11, 10।
1 को 1, 2, 4, 8 या 16 खानों के जितने कम और जितने बड़े संभव हों उतने समूहों से ढकें, किनारों से लिपटते हुए; हर समूह एक गुणन पद है जो उन चरों से बना है जो स्थिर रहते हैं। POS रूप के लिए 0 को समूहित करें।
फ़्लिप-फ़्लॉप और काउंटरों के लिए हर सक्रिय क्लॉक कोर पर निवेश पढ़ें, हर कोर के बाद अवस्था लिखें, और याद रखें कि n-बिट काउंटर 2ⁿ अवस्थाओं के बाद लौट जाता है।

डेटा अधिग्रहण और प्रतिचयन

नाइक्विस्ट मानदंड: f_s > 2·f_max, f_N = f_s/2
ऐलियास आवृत्ति: f_a = |f − k·f_s|, k = round(f/f_s)
चरण आकार: 1 LSB = V_FSR/2ᴺ
क्वांटीकरण त्रुटि (निकटतम पूर्णांकन): ±½ LSB
ADC कोड का छाँटना (ट्रंकेशन): D = ⌊V_in/LSB⌋
वियोजन r के लिए बिट: 2ᴺ ≥ span/r
आदर्श SQNR, पूर्ण-स्केल ज्यावक्र: SQNR = 6.02·N + 1.76 dB
डेटा दर: चैनल × f_s × N bit/s
मल्टीप्लेक्स्ड ADC: f_s = 1/(n·(t_c + t_set))
UART: T_b = 1/बॉड; 8N1 = प्रति बाइट 10 बिट; बाइट/s = बॉड/प्रति फ़्रेम बिट
बॉड दर विभाजक: baud = f_clk/(16·D)

विधि

लिख लें कि क्या दिया है: प्रतिदर्श दर, संकेत आवृत्तियाँ, बिट संख्या, निवेश परिसर, बॉड दर।
प्रतिचयन के प्रश्नों में हर आवृत्ति की तुलना f_s/2 से करें; इससे ऊँची आवृत्ति f_a = |f − k·f_s| पर दिखती है, जहाँ f_s का निकटतम गुणज लिया जाता है।
वियोजन के प्रश्नों में 1 LSB = V_FSR/2ᴺ ज्ञात करें, या सबसे छोटा N ज्ञात करें जिसके लिए 2ᴺ ≥ विस्तार/वियोजन हो।
डेटा दर और UART लिंक के लिए वह सब गिनें जो भेजा जाता है: चैनल, प्रति सेकंड प्रतिदर्श, प्रति प्रतिदर्श बिट या पूरे बाइट, और हर फ़्रेम के स्टार्ट, पैरिटी और स्टॉप बिट।

2अभ्यास प्रश्न

1.संख्या पद्धतियाँमध्यम

8-बिट पैटर्न 1110 0111 दो के पूरक में एक चिह्नित पूर्णांक संग्रहीत करता है। दशमलव में इसका मान N क्या है?

1110 01118 bit

N =

2.संख्या पद्धतियाँकठिन

बिट को 0001 0110 OR 1100 0000 के 8-बिट परिणाम पर सेट करें। दशमलव में परिणाम का मान R क्या है?

0001 0110OR1100 0000

R =

3.डिजिटल लॉजिक: गेट, K-मानचित्र और फ़्लिप-फ़्लॉपमध्यम

F = AC + A′B′C′ + A′BC को उसके न्यूनतम गुणनफलों के योग रूप में सरल करें। सरल किए गए व्यंजक में कितने लिटरल L हैं?

F = AC + A′B′C′ + A′BC

L =

4.डिजिटल लॉजिक: गेट, K-मानचित्र और फ़्लिप-फ़्लॉपकठिन

एक 3-बिट द्विआधारी अप काउंटर 7 (दशमलव, Q = 111) से शुरू होता है। 15 क्लॉक पल्स के बाद वह कौन-सी गिनती Q (दशमलव में) दिखाएगा?

Q₀ = 715n = 3

Q =

5.डेटा अधिग्रहण और प्रतिचयनमध्यम

एक सेंसर दाब को 1000 kPa के विस्तार में मापता है, और उसका निर्गत ADC के पूरे निवेश परिसर को भरता है। पाठ्यांक को 1 kPa तक वियोजित करना है। ADC को चाहिए बिटों की न्यूनतम संख्या N ज्ञात कीजिए।

विस्तार = 1000 kPaवियोजन = 1 kPa

N =

6.डेटा अधिग्रहण और प्रतिचयनकठिन

एक तापमान सेंसर 5 mV/°C देता है (0 °C पर 0 V)। उसका संकेत 20 गुना प्रवर्धित होकर 0 से 10 V परिसर वाले 10-बिट ADC (1 LSB = V_FSR/2ᴺ) में जाता है। एक LSB के संगत तापमान परिवर्तन ΔT_LSB ज्ञात कीजिए।

S = 5 mV/°CG = 20N = 10V_FSR = 10 V

ΔT_LSB = °C

3विलयन

1.संख्या पद्धतियाँ

उत्तर: N = −25

स्थानीय मान संख्या पद्धतियाँ: हर अंक का मान उसके मान गुणा आधार की एक घात होता है। द्विआधारी में स्थान 1, 2, 4, 8, 16, … के होते हैं; षोडशआधारी में 1, 16, 256, …, जहाँ A–F का अर्थ 10–15 है। 8-बिट दो के पूरक में सबसे बाईं बिट +128 के बजाय −128 की होती है; ऋणात्मक संख्याएँ इसी तरह संग्रहीत होती हैं।

मान जोड़ें

बाकी बिटें अपने सामान्य धनात्मक मान रखती हैं।

−128 + 64 + 32 + 4 + 2 + 1 = −25

उत्तर

N = −25

2.संख्या पद्धतियाँ

उत्तर: R = 214

बिट सेट करना: हर बिट दो की एक घात के बराबर है (128, 64, …, 1)। एक हेक्स अंक ठीक चार बिट होता है, और 8-बिट 2 के पूरक में सबसे बाएँ बिट का मान −128 होता है। बिटवाइज़ संक्रियाएँ हर बिट स्थान पर अलग-अलग काम करती हैं।

बिट-दर-बिट

OR वहाँ 1 देता है जहाँ कम से कम एक बिट 1 हो।

0001 0110

OR 1100 0000

= 1101 0110

परिणाम का मान

1101 0110₂ = 214

उत्तर

R = 214

3.डिजिटल लॉजिक: गेट, K-मानचित्र और फ़्लिप-फ़्लॉप

उत्तर: L = 7

बूलीय बीजगणित: व्यंजकों को सरल करने वाले नियम हैं X + X′ = 1 और X·X′ = 0, X + X = X, अवशोषण X + X·Y = X, संयोजन नियम X·Y + X·Y′ = X, X + X′Y = X + Y और सहमति प्रमेय XY + X′Z + YZ = XY + X′Z। डी मॉर्गन के नियम (X·Y)′ को X′ + Y′ में और (X + Y)′ को X′·Y′ में बदलते हैं। कार्नो मानचित्र इन नियमों को चित्रात्मक रूप से लगाता है: दो पड़ोसी खानों का हर समूह XY + XY′ = X का एक उपयोग है।

व्यंजक के मिनटर्म

AC → m(5, 7)

A′B′C′ → m(0)

A′BC → m(3)

समूहित करें और पढ़ें

F = BC + AC + A′B′C′

लिटरल गिनें

L = 7

उत्तर

L = 7

4.डिजिटल लॉजिक: गेट, K-मानचित्र और फ़्लिप-फ़्लॉप

उत्तर: Q = 6

फ़्लिप-फ़्लॉप और काउंटर: फ़्लिप-फ़्लॉप केवल सक्रिय क्लॉक कोर पर बदलता है। D अपना निवेश कॉपी करता है (Q⁺ = D); T तब टॉगल करता है जब T = 1; JK 00 पर स्थिर रहता है, 01 पर रीसेट करता है, 10 पर सेट करता है और 11 पर टॉगल करता है। n-बिट द्विआधारी काउंटर की 2ⁿ अवस्थाएँ होती हैं और वह 2ⁿ के मापांक में गिनता है; mod-N काउंटर 0, 1, …, N − 1 तक जाकर फिर 0 पर लौटता है, और उसे ऐसे सबसे छोटे n फ़्लिप-फ़्लॉप चाहिए जिसमें 2ⁿ ≥ N हो। रिपल काउंटर का हर चरण आवृत्ति को आधा कर देता है, इसलिए mod-N काउंटर का अंतिम निर्गत f_clk/N पर चलता है। n फ़्लिप-फ़्लॉप वाले जॉनसन काउंटर की 2n अवस्थाएँ होती हैं, रिंग काउंटर की n।

पूरे चक्र

हर 8 पल्स काउंटर को उसी अवस्था में वापस ले आते हैं।

15 = 1·8 + 7

शेष पल्स के बाद गिनती

Q = (7 + 7) mod 8 = 6

Q = 110₂

उत्तर

Q = 6

5.डेटा अधिग्रहण और प्रतिचयन

उत्तर: N = 10

ADC वियोजन: N-बिट कन्वर्टर अपने पूर्ण-स्केल परिसर V_FSR को 0 से 2ᴺ − 1 तक 2ᴺ कोड में बाँटता है। एक चरण 1 LSB = V_FSR/2ᴺ है: वह सबसे छोटा परिवर्तन जो कन्वर्टर दिखा सकता है। छाँटने वाला ADC कोड ⌊V_in/LSB⌋ देता है; निकटतम पूर्णांकन करने वाला ADC वास्तविक मान से कभी ½ LSB से अधिक दूर नहीं होता, यही उसकी क्वांटीकरण त्रुटि है। हर अतिरिक्त बिट LSB को आधा करता है और पूर्ण-स्केल ज्यावक्र के लिए आदर्श संकेत-से-क्वांटीकरण-रव अनुपात SQNR = 6.02·N + 1.76 dB में लगभग 6 dB जोड़ता है। किसी विस्तार पर वियोजन r पाने के लिए सबसे छोटा N चुनें जिसके लिए 2ᴺ ≥ विस्तार/r हो।

आवश्यक चरण

1000/1 = 1000

बिट

log₂(1000) = 9.966

2⁹ = 512 < 1000 ≤ 2¹⁰ = 1024

N = 10

उत्तर

N = 10

6.डेटा अधिग्रहण और प्रतिचयन

उत्तर: ΔT_LSB = 0.09766 °C

चरण आकार

1 LSB = 10000/1024 = 9.766 mV

ADC पर सुग्राहिता

5·20 = 100 mV/°C

तापमान वियोजन

ΔT_LSB = 9.766/100 = 0.09766 °C

उत्तर

ΔT_LSB = 0.09766 °C

ADC 100 °C पर पूर्ण स्केल तक पहुँचता है।

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